コンピューティング
理想的なユニバーサルメモリとは何か: GST467 スーパー格子PCM vs. UltraRAM

最近、研究論文がスタンフォード大学電気工学部の呉翔金とアシル・インティサル・カーン、そしてAMDのUltraRAMについて発表され、従来のメモリアーキテクチャに対する画期的な進歩が期待できるとして、技術愛好家や専門家の間で話題となっています。スーパー格子相変化メモリ(PCM)とUltraRAMはどちらも容量、速度、効率の向上を目指していますが、その根本的な原理は大きく異なります。
以下に、両者が表面的に高性能でエネルギー効率の高いコンピューティングの需要にどのようにアプローチしているかを示します:
- 新規ナノコンポジットスーパー格子PCMは、多層ナノ構造により記憶容量を増やし、ナノスケール加熱で高速操作、超低消費電力を実現します。
- UltraRAMは、コンパクトなメモリセルを相互接続することで容量を増やし、データパスを短縮し、インテリジェントな電力管理により従来製品より高速に動作します。
両者を詳細に論じた包括的なリソースはリンクで提供していますが、比較した信頼できる情報は見つかりませんでした。では、GST467 スーパー格子PCM vs. UltraRAM の対決を始めましょう。
材料と構造
各技術で使用される革新的なスーパー格子およびナノコンポジット材料は、性能、スケーラビリティ、統合能力に根本的な影響を与えます。材料と構造を比較することで、これら新興メモリソリューションの基本的な利点とトレードオフを把握できます。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 材料と構造 |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| Ge4Sb6Te7(GST467)とSb2Te3/TiTe2層のスーパー格子を利用。 | CMOSの標準6T SRAMビットセルに基づく。 |
| GST467は高速スイッチングのためにSbTeインクルージョンを含むナノコンポジット。 | 新素材なしの従来型平面またはFinFETトランジスタを使用。 |
| 原子レベルで鋭いインターフェースを持つ秩序ある低次元構造。 | 特殊インターフェース回路を備えた4Kx72bブロックで構成。 |
| 層厚さ約2-4nm、スタック総厚約60nm、スパッタリング堆積。 | 積極的なレイアウト設計ルールで高密度を実現。 |
| エキゾチックな新素材は新たな製造プロセス/装置を必要とする。 | 特別な素材や工程は不要で、ロジックと容易に統合可能。 |
スーパー格子相変化メモリは、GST467ナノコンポジットのようなエキゾチックな新素材を原子レベルで正確に配置したスーパー格子構造で利用します。この独自のナノスケール設計はスイッチング速度を向上させますが、専門的な装置が必要です。一方、UltraRAMは新素材を使用せず、標準CMOSトランジスタで実装され、既存の製造フローに容易に統合できます。
スーパー格子の超薄層(2-4nm)は比類なきスケーリングポテンシャルを提供しますが、ナノコンポジット材料と製造の複雑さが統合の課題となります。対照的に、UltraRAMの4Kx72b SRAMブロックは、従来のレイアウト技術で高密度を実現し、確立されたプロセスと互換性があります。
性能上の利点を提供しつつ、スーパー格子メモリは特殊素材と原子スケールの層構造のために新たな製造投資が必要です。UltraRAMは、破壊的な変更なしに継続的なCMOSスケーリングを活用します。
容量と密度
メモリ密度は、現代のコンピューティングワークロードが求める高容量・コンパクトなストレージソリューションを実現するための重要指標です。最大実現可能密度を評価することで、各技術が将来の高密度システムアーキテクチャを支える可能性が見えてきます。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 容量と密度 |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 実証済みの機能的40nmデバイス – これまでで最小のPCM。 | 基本単位は4Kx72b(288Kb)SRAMブロック。 |
| 優れた特性はスケーリングで高密度ポテンシャルを示唆。 | 1列に最大2048ブロックを垂直にカスケード可能。 |
| 多層3Dスタッキングで小フットプリントに超高密度を実現。 | オーバーヘッドを伴う水平カスケーディングも可能。 |
| 低消費電力と熱閉じ込めが密集3Dスタックに適合。 | カスケード列の3Dスタッキングで最高密度を実現。 |
| 3D NANDフラッシュ密度に匹敵または上回る可能性。 | 64層の3Dスタックで1ダイスタックあたり36Gbを提供。 |
新規ナノコンポジットスーパー格子相変化メモリは、40nmデバイスという史上最小のPCMセルを実現し、密度スケーリングの最前線を押し上げます。このスーパー格子技術は高速スイッチング、低消費電力、高耐久性といった優れた高密度特性を示し、3DスタッキングによりNANDフラッシュに匹敵する容量を超小型で実現可能です。
UltraRAMは、4Kx72b SRAMブロックを用いた独自のカスケード方式を採用します。最大2048ブロックを垂直に接続することで、1列あたり最大576Mbの容量を提供します。水平カスケーディングにより2D配列密度も拡張可能です。64層の3Dダイ/ウェーハスタッキングと組み合わせることで、単一コンパクトスタック内に36Gbという膨大な容量を実現します。
消費電力
電力消費の最小化は、特にモバイルや組み込みアプリケーションにおけるエネルギー効率の高いコンピューティングに不可欠です。アクティブ電力とスタンバイ電力を比較することで、用途別に最適なエネルギープロファイルが明らかになります。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 消費電力 |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 40nmデバイスで記録的に低い85μAリセット電流。 | 40nmで4Kx72bブロックあたり60-100μWのアクティブ電力。 |
| 約5 MW/cm2のリセット電力密度、PCMの10倍以上低減。 | スリープモードでスタンバイ電力を数ミリワットに削減。 |
| スーパー格子構造が熱を閉じ込め、熱損失を最小化。 | パワーゲーティングでアイドルリークをほぼゼロに。 |
| SbTeナノクラスターが結晶化バリアとスイッチング電力を低減。 | ドロージーモードで適度なリーク低減と高速ウェイクアップを実現。 |
| 超小型化により相変化の絶対電力が削減。 | 構成可能モードで電力と性能のトレードオフを最適化。 |
| 0.1Vで10nWの読出し電力、高抵抗比を活用。 | 固有の低電圧CMOS効率を活用。 |
| 非揮発性のためスタンバイ電力はほぼゼロ。 | 低電力・高性能用途に極めて効率的。 |
新規GST467スーパー格子PCMは、独自のナノ構造材料により比類なき低消費電力を実現します。40nmスケールで記録的に低い85µAリセット電流を示し、わずか60µWの書き込み電力、そして5 MW/cm2という驚異的な電力密度(標準PCMの10倍以上低減)を達成しています。このスーパー格子はSbTeナノクラスターで熱を正確に閉じ込め、結晶化バリアを低減します。
UltraRAMは標準低電圧CMOS回路を活用し、コンパクトな4Kx72bブロックで60-100µWのアクティブ電力に最適化されています。その真価は構成可能なスタンバイモードにあり、スリープでアイドルリークをミリワットに、パワーゲーティングで完全にゼロにします。ドロージーモードは適度なリーク低減と高速ウェイクアップをバランスさせ、さまざまなアプリケーションで最適なエネルギー/性能トレードオフを実現します。
電圧スケーリング
低電圧での動作は、先進的なCMOSロジックノードとの統合に不可欠です。電圧スケーリングの可能性を評価することで、最新半導体製造および設計フローとの互換性が明らかになります。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 電圧スケーリング |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 40nmデバイスで記録的に低い0.7V動作を実証。 | 40nm CMOSプロセスで約0.9Vまで動作。 |
| 先進CMOSロジック電圧との互換性に重要。 | ビットセル/周辺回路の堅牢な低電圧動作を設計。 |
| スーパー格子構造が低電圧スイッチングのために電界を閉じ込め。 | 超低Vtロジックプロセスで高密度ロジックを利用可能。 |
| SbTeナノクラスターが低電圧で均一な核生成を実現。 | 小規模ビットセル配列が低電圧で性能を維持。 |
| 鋭い遷移がセット/リセット電圧マージンを最小化し低Vreadを実現。 | カスケードアーキテクチャが局所電圧ドメインを提供。 |
| さらなるスケーリングに有利だがON/OFF比が制限要因。 | 7nmで0.65V以下へのスケールが可能。 |
| 十分な書き込み電流を得るにはアクセストランジスタ設計が重要。 | 負ビットライン書き込み、ブーストなどの支援技術。 |
GST467スーパー格子PCMは、40nmデバイスで記録的に低い0.7V動作を実現しました。この超低電圧動作は、最新のCMOSロジックが約0.8Vで動作する環境との互換性にとって重要です。スーパー格子のナノスケール閉じ込めにより最小電圧でスイッチングが可能で、SbTeナノクラスターが均一な結晶化を促進します。鋭いセット/リセット遷移により低電圧リード時の電圧マージンが最小化されます。
UltraRAMのCMOS基盤は、40nmノードで0.9Vまでの動作を可能にします。SRAMビットセルと周辺回路は、トランジスタ最適化や特殊回路トポロジーなどの技術で低電圧動作を信頼性高く実現しています。小規模ビットセル配列と局所電圧ドメインが低電圧課題を緩和し、UltraRAMは最先端の低Vtロジックプロセスを活用し、支援技術により0.65V以下へのスケールも見込めます。
アクセス速度とレイテンシ
メモリ性能はシステム全体の応答性とスループットに直接影響します。アクセス時間とレイテンシをベンチマークすることで、さまざまなアプリケーション要件に最適な性能領域が明らかになります。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: アクセス速度とレイテンシ |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 40nmデバイスで40nsの書き込み時間、PCMの10倍以上高速。 | 40nmで72ビットワードあたり約1nsの読出し/書き込み時間。 |
| 10ns未満の読出し時間を実証、DRAM性能に迫る。 | 多くの操作で単一サイクルの読出し/書き込み。 |
| SbTeナノクラスターが迅速かつ均一な結晶核生成を促進。 | カスケードブロックが配列全体で並列アクセスを可能に。 |
| 閉じ込め加熱により高速な温度上昇/下降が可能。 | パイプラインレジスタがクリティカルパスを分割し高クロック速度を実現。 |
| 高抵抗比が高速で信頼性の高いセンシングを実現。 | 回路がシンプルなため読出しが書き込みよりやや高速。 |
| 配列レベルの書き込みレイテンシはDRAMより依然高い。 | 小さな72ビットワードサイズは大容量転送に多くの操作が必要。 |
| 非破壊読出しにより実効読出しレイテンシを低減可能。 | 高クロックと高度インターフェースが小ワード幅の影響を緩和。 |
GST467スーパー格子PCMは、40nsの書き込み時間で新たな速度バリアを突破し、同スケールの標準PCMより10倍以上高速です。ナノクラスターが迅速で均一な結晶化を促し、閉じ込め加熱が温度遷移を速め、これらが高速性能を実現しています。さらに、10ns未満の読出し時間はDRAMに近づいており、高抵抗比が信頼性の高いセンシングを可能にしています。
単一セルとしては超高速ですが、相変化メカニズムの固有制約によりPCM配列の書き込みレイテンシは依然課題です。高度なアーキテクチャとインターフェースで並列化することでこのボトルネックを緩和できます。特に非破壊読出しは書き戻しオーバーヘッドを排除し、実効レイテンシを低減します。
UltraRAMはSRAMに似た設計を活かし、72ビットワードで約1nsのアクセス時間を実現します。コンパクトなビットセル配列と高度回路により、カスケードブロック間で並列アクセスが可能で、パイプラインレジスタがレイテンシ影響を最小化します。狭いワード幅は大容量転送に多くの操作が必要ですが、高クロックと高度インターフェースがそれを補います。総合的に、UltraRAMは従来のSRAMに匹敵する卓越した性能を提供します。
耐久性と保持性
堅牢なデータ耐久性と保持性は、非揮発性ストレージにとって重要であり、長期的な信頼性運用を可能にします。これらの指標を比較することで、コード保存からデータベースキャッシュまでの幅広い用途への適合性が評価できます。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 耐久性と保持性 |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 40nmデバイスで2×10^8書き込みサイクルを実証。 | 揮発性SRAM技術のため長期保持は設計外。 |
| スーパー格子構造が欠陥を最小化し応力を均等に分散。 | 「シャドウストレージ」が埋め込みNVMで短期バックアップを提供。 |
| 85°Cで10^5時間の保持、約10年の寿命を予測。 | バックアップ時間はシャドウNVM(例:ReRAM)の耐久性に依存。 |
| 規則的な層が拡散/分離を長期間抑制。 | 耐久性は10^15サイクル超、トランジスタの摩耗が制限要因。 |
| 高い結晶化温度がアモルファス相の安定性を向上。 | SRAMセルはロジックトランジスタより低ストレスで設計。 |
| 長時間スケールでは原子再配置が根本的な制限。 | ロジックよりはるかに高い書き込みトラフィックを許容。 |
| エラー訂正で保持時間をさらに延長可能。 | データアーカイブ目的ではないが、アクティブ使用には堅牢。 |
GST467スーパー格子PCMは、40nmデバイスで2×10^8書き込みサイクルを超える卓越した耐久性を示し、従来のPCMを大幅に上回ります。高度なスーパー格子構造が欠陥を最小化し、応力を均等に分散させることでこの堅牢性に寄与しています。データ保持も優れており、85°Cで10^5時間の保持が実証され、室温で10年以上の寿命が予測されます。
UltraRAMは揮発性SRAM技術であるため、長期の非揮発性保存は想定されていません。しかし、ReRAMなどの埋め込み非揮発性メモリを利用した「シャドウストレージ」を統合し、電源喪失時の短期データバックアップを提供します。その真価は、トランジスタの摩耗が限界になるまで10^15サイクルを超える驚異的な耐久性にあります。低ストレスで設計されたセルは、周囲のロジックよりはるかに高い書き込みトラフィックに耐えられます。
アーカイブ保存を目的としたものではありませんが、両技術はそれぞれのターゲットアプリケーション領域に合わせた魅力的な耐久性と保持性を示しています。GST467 PCMは非揮発性ストレージ向け、UltraRAMは信頼性の高いアクティブインメモリコンピューティング向けです。
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エラー訂正
データ整合性を確保するためのエラー訂正は、あらゆるメモリサブシステムにとって不可欠です。ECCの能力とオーバーヘッドを評価することで、実運用における信頼性が明らかになります。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: エラー訂正 |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| ハミングやBCHコードなど既存ECC方式を活用可能。 | 周辺CMOSロジック/SRAMと同じECCを活用。 |
| PCM特有の非対称「スタックアット」エラーに対応必要。 | SRAMの信頼性によりECC頻度は低減可能。 |
| スタックアットエラー緩和に書き込み‑検証‑書き込みを使用。 | 差動センシングでノイズ耐性向上。 |
| 高度なスタックアット対応ECCコードで更なる訂正。 | 72ビットデータ幅全体のマルチビットエラーに対応必要。 |
| ECCの複雑さと密度/性能のトレードオフ。 | 階層型/インタリーブ方式でECCオーバーヘッド削減。 |
| 多数サイクルでの長期信頼性にECCは必須。 | 既存ロジックECCエンジン/IPと統合。 |
エラー訂正は、任意のメモリ技術の長期信頼性を確保するために重要です。GST467スーパー格子PCMは、ハミングやBCHコードなどの確立されたECC方式を容易に活用できます。ただし、PCM特有の非対称「スタックアット」エラーに対処するため、書き込み‑検証‑書き込みや高度なスタックアット対応ECCアルゴリズムが必要で、複雑さとオーバーヘッドのトレードオフが生じます。
UltraRAMの大きな利点は、同じECCエンジンとIPにシームレスに統合できる点です。これにより、周囲のCMOSロジックやSRAMも保護されます。SRAMに近い信頼性を持つため、ECCの介入頻度は低く抑えられますが、72ビットデータパス全体でのマルチビットエラー管理には慎重なECC設計が必要です。階層型やインタリーブ方式のECCを採用すれば、オーバーヘッドを削減しつつ堅牢な訂正能力を維持できます。
最終的に、包括的なエラー訂正の導入は、両メモリ技術の信頼性ある長期運用に不可欠です。アーキテクチャとエラープロファイルは異なりますが、最適なECC実装は検出力、面積コスト、性能への影響をバランスさせる必要があります。
チップ内変動とドリフト
プロセス変動や動作ドリフトはメモリ性能と信頼性を低下させる可能性があります。これらの要因に対する感受性を評価することで、製造上の複雑さと動作安定性に関する洞察が得られます。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: チップ内変動とドリフト |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 高度に秩序化されたスーパー格子がセル間変動を最小化。 | トランジスタ変動(Vt、リーク電流等)の影響を受ける。 |
| 小さく閉じ込められたセルジオメトリがエッジ効果を低減。 | ビットセル変動を補償する適応バイアス/較正が可能。 |
| 適応書き込み/MLC方式でセット/リセット電圧のばらつきを処理。 | 冗長性とリペアで歩留まりと信頼性を向上。 |
| 従来PCMに比べてはるかに低い抵抗ドリフト。 | HKMGトランジスタと統計的設計で変動を低減。 |
| 規則的な層と高い結晶化温度がアモルファス相を安定化。 | ウェアレベリングとリフレッシュで老化/摩耗効果を管理。 |
| ドリフト補償がセルごとの時間変化を追跡。 | 回路/システム技術で全体的に信頼性を確保。 |
| 強化ECCがドリフトによる変動増加に耐性。 | 成熟したCMOS変動対応設計手法を活用。 |
チップ内変動とドリフトは、非揮発性メモリ全般、特に新規スーパー格子PCM技術にとって信頼性上の課題です。この技術の高度に秩序化されたナノ構造は、従来PCMに比べてセル間変動を最小化し、安定したスーパー格子層と高い結晶化温度により時間経過による抵抗ドリフトを本質的に低減します。
しかし、これらの課題に対抗するためには、適応書き込み/MLCプログラミング、ドリフト補償アルゴリズム、強化ECCといった技術が不可欠です。これらの回路レベル手法は、スイッチング電圧や抵抗レベルの残存変動を補正します。継続的なモニタリングと調整により、長期的な動作と性能の一貫性が確保されます。
CMOSベースのUltraRAMでは、すでに確立された変動対応設計手法が活用されています。特に適応バイアスや冗長性がトランジスタミスマッチの影響を緩和し、プロセス最適化が摩耗メカニズムからの変動を最小化します。また、統計的シミュレーションが期待されるばらつきを予測し、設計に反映されています。総じて、これらの対策は製造時と運用時の不安定性に対処するツールキットを構築します。
要するに、両技術はアーキテクチャ上の利点と回路技術を組み合わせて変動を管理し、ドリフトやミスマッチに対処しつつ、実世界での堅牢な長期信頼性を実現しています。
3D統合ポテンシャル
3Dスタッキングは、特にスペースが限られたデバイスにおいてメモリ密度と帯域幅を劇的に向上させます。その実現可能性を分析することで、将来の高性能・高容量システムアーキテクチャへのスケーラビリティに関する洞察が得られます。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 3D統合ポテンシャル |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 高度に均一なスーパー格子構造が垂直スタッキングを可能に。 | 標準CMOSと互換性があり、3Dモノリシック統合を実現。 |
| 複数のスーパー格子層と垂直相互接続。 | 標準プロセスを用いたスタックダイまたは順次層。 |
| 複数配列をスタックすることではるかに高い密度を実現。 | CMOSスケーリングに伴う高いスケーラビリティと低電力。 |
| 短い垂直接続がレイテンシと電力を削減。 | インメモリコンピューティング向けにロジックとメモリが密接に結合。 |
| 3D電力密度から生じる熱管理課題。 | 3Dスタックにおける電力供給、テスト、信頼性課題。 |
| 垂直相互接続の歩留まりと信頼性が重要。 | レギュレータ、DVFS、冗長性などの技術で3D実現性を確保。 |
| 64層の3D PCM配列の実証的な先駆的研究が進行中。 | ビッグデータ/機械学習向けに超高容量を実現。 |
GST467 PCMの革新的なスーパー格子構造は、垂直スタッキングによる3D統合を本質的に可能にします。原子レベルで均一な複数層がTSVなどの垂直相互接続で結ばれ、数多くの配列をスタックすることで密度が劇的に向上します。ただし、集中した3D電力密度から熱管理の課題が生じます。
一方、UltraRAMはCMOS互換性を活かし、単純な3D統合—モノリシックに順次層を形成するか、個別ダイをスタックするか—を実現します。そのスケーラビリティはロジックノードと共に高まっており、インメモリコンピューティングなどの用途に最適です。ただし、電力供給、テスト、冗長性といった3Dスタックの信頼性確保が重要です。
両技術とも独自のトレードオフを伴いながら強力な3Dポテンシャルを示していますが、さらなる研究が必要です。64層のGST467プロトタイプとペタバイト規模の3D UltraRAM予測は、密度と帯域幅の向上に有望です。3D製造技術の習得が、これらイノベーションの真の高容量・高性能の約束を開く鍵となります。
統合と製造

最終的に、既存の半導体プロセスや設計フローとのシームレスな統合が商業的実現性に不可欠です。統合の複雑さを考慮することで、実際の製造導入課題が浮き彫りになります。
GST467 スーパー格子PCM vs. UltraRAM パラメータ: 統合と製造 |
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| 新規ナノコンポジットスーパー格子相変化メモリ | UltraRAM |
| 標準薄膜堆積/パターニングで製造。 | 標準CMOSロジックプロセスと高い互換性。 |
| スーパー格子層は正確な厚さ管理が必要。 | 従来の6T SRAMビットセル設計に基づく。 |
| スーパー格子損傷防止のためエッチ/クリーン工程を変更。 | UltraRAM機能のためビットセルに小規模な変更。 |
| スーパー格子統合には熱予算管理が必要。 | ロジックトランジスタと配線とのシームレス統合。 |
| バリア層がCMOS材料との相拡散を防止。 | 7nm以降の高密度ビットセルでスケーリング課題。 |
| 高性能・低消費電力デバイスの有望な結果。 | スケーリングに先進的なパターニングとFinFETトランジスタを活用。 |
| 新規3D統合とパッケージングも検討中。 | 新モードとパッケージングのための徹底的なテスト/特性評価。 |
革新的なGST467スーパー格子PCMは、標準的な堆積とパターニングプロセスで製造され、統合の最前線を切り開こうとしています。しかし、原子レベルで正確なスーパー格子層は厳格な厚さ管理を要求します。
損傷を防ぐためにエッチ化学を変更し、CMOSとの相拡散を防ぐために熱予算管理が重要です。バリア層はこの熱予算管理を支援し、CMOSとの相拡散を防止します。
対照的に、UltraRAMは従来の6T SRAMビットセルを標準ロジックプロセス内で改変し、シームレスに統合します。この設計変更によりスリープモードなどの機能が実現し、トランジスタや配線と直接インターフェースします。ただし、7nm以降のスケーリングには先進的なパターニングと新しいトランジスタアーキテクチャが必要です。そのため、新機能やパッケージングを評価するための包括的なテスト手法と高度なパッケージングスキームが求められます。
まとめ
スーパー格子PCMとUltraRAMはそれぞれ独自の価値提案と制限を持ちますが、万能メモリという単一の勝者を目指すのではなく、システムアーキテクトはこれら破壊的技術を協調的に最適化すべきです。
AMD 価格チャート
年間収益が226.8億ドル、純利益が8.54億ドルのAdvanced Micro Devices (AMD ) は、Nvidia (NVDA ) のような大手プレイヤーの覇権に挑戦し、UltraRAMのようなイノベーションでよりプレミアムなカテゴリへ進出しようとしています。一方、Intel (INTC ) はPCMへの関心を公に示しており、将来的な関連性を高めています。












